Ubuntu下FT2232HQ同步FIFO模式传输速度偏低的优化咨询
FT2232H同步FIFO模式Linux下提速建议
1. 移除代码中的性能瓶颈
- 删除无效串口操作:你已经卸载了
ftdi_sio和usbserial驱动,使用的是FTDI官方D2XX库,因此setserial命令完全无效,直接删除以下两行:system("setserial /dev/ttyUSB0 low_latency"); system("setserial /dev/ttyUSB1 low_latency"); - 移除调试输出:循环内的
std::cout<<i<<std::endl;是严重的性能杀手——标准输出的同步IO会频繁阻塞进程,拖慢读取速度。直接删除该行,测试完成后再打印统计信息。
2. 优化D2XX库配置
- 确认延迟定时器生效:你设置了
LatencyTimer = 2,但要检查FT_SetLatencyTimer的返回值,确保配置成功:ftStatus = FT_SetLatencyTimer(ftHandle0, LatencyTimer); if(ftStatus != FT_OK) { printf("FT_SetLatencyTimer failed\n"); retCode=1; goto exit; } - 调整USB缓冲区大小:将
FT_SetUSBParameters的缓冲区调至更大(比如512KB,即0x80000),减少USB传输的次数:FT_SetUSBParameters(ftHandle0, 0x80000, 0x80000); - 修改超时设置:连续传输场景下,将读超时设为0(无限等待),避免因超时中断读取流程:
ftStatus = FT_SetTimeouts(ftHandle0, 0, 500); - 禁用不必要的流控制:同步FIFO模式下,FPGA通过
TXE引脚控制发送,无需RTS/CTS流控制,改为禁用:FT_SetFlowControl(ftHandle0, FT_FLOW_NONE, 0x0, 0x0);
3. 优化读取逻辑
- 处理部分读取的情况:不要因
byteCount != 65536直接退出,而是累加总字节数,适应FPGA可能的突发发送:DWORD totalBytes = 0; start = std::chrono::high_resolution_clock::now(); while(totalBytes < 1024*1024*1024) { // 读取1GB if(FT_Read(ftHandle0, rxBuffer, 65536, &byteCount) != FT_OK) { printf("Error while reading from the device. Exiting.\n"); goto exit; } totalBytes += byteCount; } stop = std::chrono::high_resolution_clock::now(); - 尝试异步读取:使用
FT_ReadAsync配合回调函数,实现非阻塞读取,提升CPU利用率:void WINAPI ReadCallback(FT_HANDLE ftHandle, DWORD dwBytesReceived, DWORD dwUserContext) { // 处理读取到的数据,继续发起下一次异步读取 FT_ReadAsync(ftHandle, rxBuffer, 65536, ReadCallback, (DWORD)ftHandle); } // 初始化时启动异步读取 FT_ReadAsync(ftHandle0, rxBuffer, 65536, ReadCallback, (DWORD)ftHandle0);
4. Linux系统层面优化
- 禁止USB设备自动挂起:找到FT2232H的设备路径(比如
/sys/bus/usb/devices/1-2),执行:sudo echo -10 > /sys/bus/usb/devices/[你的设备路径]/power/control - 调整内核参数:编辑
/etc/sysctl.conf,添加以下参数后执行sudo sysctl -p生效:vm.dirty_bytes=67108864 # 减少内存页回写频率,提升IO效率 - 启用实时调度:在代码中添加实时调度设置,避免进程被抢占(需要root权限运行):
#include <sched.h> // 在FT_Open成功后添加 struct sched_param param; param.sched_priority = 50; if(sched_setscheduler(0, SCHED_FIFO, ¶m) != 0) { perror("sched_setscheduler failed"); }
5. FPGA端代码优化
- 优化WR信号时序:当前代码中WR信号在每个时钟周期跳变,可改为当TXE有效时持续拉低WR,直到TXE变高,减少信号抖动:
process(CLK60M,TXE) begin if(CLK60M'event and CLK60M ='1')then if(TXE='0')then DATA <= DATA + 1; WR <= '0'; else WR <= '1'; end if; end if; end process; - 确认时钟稳定性:确保CLK60M的时钟质量,避免抖动或频率偏差,这会直接影响FT2232H的接收效率。
内容的提问来源于stack exchange,提问作者deponce ye
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